• 百度移动下拉词排名

    • 用verilog设计一个8位二进制加法器

    • 用verilog写ROM模块

    • 用verilog-hdl语言设计一个二-十进制译码器

    • 用verilog hdl语言实现四选一选择器实验

    • 用verilog设计一个全加器

    • 用verilog 语言设计小数分频器

    • 用verilog设计一个3-8译码器

    • 用verilog设计一个四选一数据选择器

    • 用verilog语言60秒表计数器

    • 用verilog语言米勒法和布尔法设计序列检测器

    • 用verilog语言设计二层电梯

    • 用verilog实现开方

    • 用verilog设计一个8位十进制加法器

  • 搜狗移动下拉词排名

  • 神马移动下拉词排名